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000
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01370nam 2200277 450
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001
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CAL 012025064707
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20250326085443.0
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@a978-7-121-49690-5@dCNY88.00
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@a20250326d2025 em y0chiy50 ea
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@achi
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@ar
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@a基于Vivado的FPGA时序约束实战@Aji yu Vivado de FPGA shi xu yue shu shi zhan@f韩彬, 周建文编著
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@a北京@c电子工业出版社@d2025.03
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@a224页@c图@d26cm
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@a电子系统EDA新技术丛书@Adian zi xi tong EDA xin ji shu cong shu
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@a韩彬, 网名CrazyBingo (CB), 分别在杭州电子科技大学、西安电子科技大学获得学士学位、硕士学位, 曾在中兴微电子 (深圳市中兴微电子技术有限公司) 负责多年的多媒体SOC前端开发工作。创立了深圳市奧奥唯思科技有限公司 (SZOVS), 致力于FPGA图像加速业务, 以及国产FPGA解决方案的推广事业。
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330
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@a本书深入讲解时序约束的原理和实战, 将芯片时序约束的经验应用于FPGA, 以最大限度地提升FPGA性能。本书旨在为有经验的工程设计者与工程管理者提供深入的时序约束知识, 特别适合高级硬件设计工程师、研发部经理、专业的EMC工程师等。
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410
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0
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@12001 @a电子系统EDA新技术丛书
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0
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@a可编程序逻辑器件@Ake bian cheng xu luo ji qi jian@x系统设计
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690
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@aTP332.1@v5
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701
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0
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@a韩彬@Ahan bin@4编著
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701
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0
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@a周建文@Azhou jian wen@4编著
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0
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@aCN@b人天书店@c20250326
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905
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@b21524555-57@dTP332.1@e32@f3
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| 基于Vivado的FPGA时序约束实战/韩彬, 周建文编著.-北京：电子工业出版社，2025.03 |
| 224页：图；26cm.-(电子系统EDA新技术丛书) |
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| ISBN 978-7-121-49690-5：CNY88.00 |
| 本书深入讲解时序约束的原理和实战, 将芯片时序约束的经验应用于FPGA, 以最大限度地提升FPGA性能。本书旨在为有经验的工程设计者与工程管理者提供深入的时序约束知识, 特别适合高级硬件设计工程师、研发部经理、专业的EMC工程师等。 |
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正题名：基于Vivado的FPGA时序约束实战
索取号：TP332.1/32
预约/预借
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登录号
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条形码
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馆藏地/架位号
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状态
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备注
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1
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1524555
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215245553
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十四楼书库/
[索取号:TP332.1/32]
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在馆
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架位导航
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2
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1524556
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215245562
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十四楼书库/
[索取号:TP332.1/32]
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在馆
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架位导航
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3
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1524557
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215245571
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十四楼书库/
[索取号:TP332.1/32]
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在馆
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架位导航
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